verilog错误整理
来源:互联网 发布:java文件上传 编辑:程序博客网 时间:2024/06/07 08:57
做课设第一次学verilog,一些很简单的错误,网上也找不到解释,先记录一下,遇到再更新,方便以后忘了回来看吧。
1.提示第一行的未知符号错误——可能是用记事本或者其他软件编辑.v文件的时候,中文格式下加了回车之类的,用modelsim打开就能看到乱码
2.quartus ii中最顶层文件名与工程名一致
3.** Error: E:/modelsim65SE/wangjinming/nine_chapter/serial_pal/serial_pal.v(1): near "EOF": syntax error, unexpected "end of source code"——莫名奇妙的结束,可能是没写end,endmodule,也用可能是clk没有给初值,一直高阻态
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