共模电感
来源:互联网 发布:mybatis like sql注入 编辑:程序博客网 时间:2024/04/29 17:26
共模电感
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共模电感
共模电感(Common mode Choke),也叫共模扼流圈,常用于电脑的开关电源中过滤共模的电磁干扰信号。在板卡设计中,共模电感也是起EMI滤波的作用,用于抑制高速信号线产生的电磁波向外辐射发射。
编辑本段初识共模电感
共模电感的一种
共模电感
编辑本段共模电感工作原理
为什么共模电感能防EMI?要弄清楚这点,我们需要从共模电感的结构开始分析。 共模电感的滤波电路,La和Lb就是共模电感线圈。这两个线圈绕在同一铁芯上,匝数和相位都相同(绕制反向)。这样,当电路中的正常电流流经共模电感时,电流在同相位绕制的电感线圈中产生反向的磁场而相互抵消,此时正常信号电流主要受线圈电阻的影响(和少量因漏感造成的阻尼);当有共模电图2 图3
编辑本段漏感和差模电感
对理想的电感模型而言,当线圈绕完后,所有磁通都集中在线圈的中心内。但通常情况下环形线圈不会绕满一周,或绕制不紧密,这样会引起磁通的泄漏。共模电感有两个绕组,其间有相当共模电感
编辑本段从看板卡整体设计看共模电感
概述
在一些主板上,我们能看到共模电感,但是在大多数主板上,我们都会发现省略了该元件,甚至有的连位置也没有预留。这样的主板,合格吗? 不可否认,共模电感对主板高速接口的共模干扰有很好的抑制作用,能有效避免EMI通过线缆形成电磁辐射影响其余外设的正常工作和我们的身体健康。但同时也需要指出,板卡的防E共模电感
主板Layout(布线)设计
对优秀的主板布线设计而言,时钟走线大多会采用屏蔽措施或者靠近地线以降低EMI。对多层PCB设计,在相邻的PCB走线层会采用开环原则,导线从一层到另一层,在设计上就会避免导线形成环状。如果走线构成闭环,就起到了天线的作用,会增强EMI辐射强度。 信号线的不等长同样会造成两条线路阻抗不平衡而形成共模干扰,因此,在板卡设计中都会将信号线以蛇形线方式处理使其阻抗尽可能的一致,减弱共模干扰。同时,蛇形线在布线时也会最大限度地减小弯曲的摆幅,以减小环形区域的面积,从而降低辐射强度。 在高速PCB设计中,走线的长度一般都不会是时钟信号波长1/4的整数倍,否则会产生谐振,产生严重的EMI辐射。同时走线要保证回流路径最小而且通畅。对去耦电容的设计来说,其设置要靠近电源管脚,并且电容的电源走线和地线所包围的面积要尽可能地小,这样才能减小电源的波纹和噪声,降低EMI辐射。 当然,上述只是PCB防EMI设计中的一小部分原则。主板的Layout设计是一门非常复杂而精深的学问,甚至很多DIYer都有这样的共识:Layout设计得优秀与否,对主板的整体性能有着极为重大的影响。主板布线的划断
如果想将主板电路间的电磁干扰完全隔离,这是绝对不可能的,因为我们没有办法将电磁干扰一个个地“包”起来,因此要采用其他办法来降低干扰的程度。主板PCB中的金属导线是传递干扰电流的罪魁祸首,它像天线一样传递和发射着电磁干扰信号,因此在合适的地方“截断”这些“天线”是有用的防EMI的方法。“天线”断了,再以一圈绝缘体将其包围,它对外界的干扰自然就会大大共模电感
主板接口的设计
不知大家是否注意到,现在的主板都会附送一块开口的薄铁挡片,其实这也是用来防EMI的。虽然现在的机箱EMI屏蔽性能都不错,但电磁波还是会从机箱表面的开孔处泄漏出来,如PS/2接口、USB接口以及并、串口等的开口处。孔的大小决定了电磁干扰的泄露程度。开口的孔径越小,电磁干扰辐射的削弱程度越大。对方形孔而言,L就是其对角线长度。 使用了挡片之后,挡片上翘起的金属触片会和主板上的输入输出部分很好地通过机箱接地,不但衰减了EMI,而且减小了方孔的尺寸,进一步缩小L值,从而可以更有效地屏蔽电磁干扰辐射。 上述三点只是主板设计中除电路设计之外的几个主要防EMI设计,由此可见,主板的防EMI设计是一个整体的概念,如果整体的设计不合格,就会带来较大的电磁辐射,而这些也不是一个小小的共模电感所能弥补的。编辑本段从必要性看共模电感
共模电感缺失=防EMI性能低下?这样的说法显然是颇为片面的。 诚然,由于国家现在的EMI相关规范并不健全,部分厂商为了省料就钻了这个空子,在整体防EMI性能上都大肆省料压缩成本(其中就包括共模电感的省略),这样做的直接后果就是主板防EMI性能极其低下;但是对于那些整体设计优秀,用料不缩水的主板,即使没有共模电感,其整体防EMI性能仍能达到相关要求,这样的产品仍然是合格的。因此,单纯就是否有共模电感这一点来判断主板的优劣.编辑本段共模电感的测量与诊断
概述
电源滤波器的设计通常可从共模和差模两方面来考虑。共模滤波器最重要的部分就是共模扼流圈,与差模扼流圈相比,共模扼流圈的一个显著优点在于它的电感值极高,而且体积又小,设计共模扼流圈时要考虑的一个重要问题是它的漏感,也就是差模电感。通常,计算漏感的办法是假定它为共模电感的1%,实际上漏感为共模电感的 0.5% ~ 4%之间。在设计最优性能的扼流圈时,这个误差的影响可能是不容忽视的。漏感的重要性
漏感是如何形成的呢?紧密绕制,且绕满一周的环形线圈,即使没有磁芯,其所有磁通都集中在线圈“芯”内。但是,如果环形线圈没有绕满一周,或者绕制不紧密,那么磁通共模电感
共模扼流圈综述
滤波器设计时,假定共模与差模这两部分是彼此独立的。然而,这两部分并非真正独立,因为共模扼流圈可以提供相当大的差模电感。这部分差模电感可由分立的差模电感来模拟。 为了利用差模电感,在滤波器的设计过程中,共模与差模不应同时进行,而应该按照一定的顺序来做。首先,应该测量共模噪声并将其滤除掉。采用差模抑制网络(Differential Mode Rejection Network),可以将差模成分消除,因此就可以直接测量共模噪声了。如果设计的共模滤波器要同时使差模噪声不超过允许范围,那么就应测量共模与差模的混合噪声。因为已知共模成分在噪声容限以下,因此超标的仅是差模成分,可用共模滤波器的差模漏感来衰减。对于低功率电源系统,共模扼流圈的差模电感足以解决差模辐射问题,因为差模辐射的源阻抗较小,因此只有极少量的电感是有效的。 尽管少量的差模电感非常有用,但太大的差模电感可以使扼流圈发生磁饱和。可根据公式(2)作简单计算来避免磁饱和现象的发生。用LISN原理测量共模扼流圈饱和特性的方法
测量共模线圈磁芯(整体或部分)的饱和特性通常是很困难的。通过简单的试验可以看出共模滤波器的衰减在多大程度上受由60Hz编置电流引起的电感减小量的影响。进行此项测试需要一台示波器和一个差模抑制网络(DMRN)。首先,用示波器来监测线电压。按如下方法从示波器的A通道输入信号,将示波器的时间基准置为2ms/div,然后将触发信号加在A通道上,在交流电压达到峰值时会有线电流产生,此时滤波器效能的降级是意料中的事情。差模抑制网络(DMRN)的输入端连接到LISN,输出端用50的阻抗进行匹配且与示波器的B通道相连。当共模扼流圈工作在线性区时,在输入电流波动期间,B通道监测到的发射增加值不超过6—10dB。图1为此测试在示波器上显示的结果,上面的曲线为共模发射;下面的曲线为线电压。在线电压峰值期间,桥式整流器正向导通且传送充电电流。 图1 示波器上显示的由于60Hz充电电流引起的共模扼流圈的降级图一
图2 共模辐射等效电路
用电流原理测量共模扼流圈饱和特性的方法
如果测试人员相当谨慎,那么就可以采取类似MIL-STD-461中的测试装置来检测共模扼流圈的饱和特性。这个原理的应用如下:测试时采用两只电流探头,低频探头监测线电流,高频探头仅测量共模发射电流。线电流监视器作为触发源。不过,使用电流探头的一个隐患是差模电流衰减是管芯内绕组导线对称性的函数。如果精心合理安排绕线布局的话,30dB左右的差模电流衰减是能够得到的。即使达到这个衰减值,测得的差模分量也可能超过预期的共模分量值。可用如下两项技术来解决这一问题:第一,将一只6kHz转折频率的高阶高通滤波器与示波器串联(注意应用50的终端阻抗进行匹配)。第二,在每只10μF的电容与电源总线之间接入一根导线。为了测量共模辐射,电流探头应夹在这些载有极小线电流的导线近旁。共模扼流圈内存在的差模与共模磁通
为了快速且浅显地介绍共模扼流圈的作用,可考虑采用以下论述:“共模扼流圈管芯两侧的磁场相互抵消,因此不存在磁通使管芯饱和。”尽管这种论述对共模扼流圈作用的直觉叙述具体化了,但实质上并非如此。参考以下围绕麦克斯韦方程所进行的讨论
* 假设电流密度J产生磁场H,那么就可得出结论:附近的另一个电流不会抵消或阻止磁场或者是由此而产生的电场。 * 同样一个相邻的电流可以导致磁场路径的改变。 * 在环形共模电感的特殊场合中,每条引线中的差模电流密度可假定是相等的,且方向相反。所以由此而产生的磁场必定在环形磁芯周边上的总和为0,而在其外部则不为0! 磁芯的作用就好像它在线圈绕组的间隙处裂为两半时所表现出来的效果一样。每个绕组在环形线圈一半的区域内产生磁场,意指穿过空气的磁场必定会形成自封闭回路,图3是环形磁芯和差模电流磁路的示意图。图3 共模环形磁芯中差模磁路示意图
漏感综述
共模扼流圈能发挥一定的作用是由于μcm比μdm大好几个数量级的缘故,因为共模电流通常很小,可以通过使L/D保持在较低值来获得更小的μdm。 为了得到共模电感,同时又要使差模电感最小,最好是采用横截面积较大的磁芯绕制成多匝线圈。采用较大的螺旋管磁芯,也并非一定要这样的磁芯,可在共模扼流圈内并入有效的差模电感。因为差模磁通是远离磁芯(环形结构)的,因此可能会产生极强的辐射。尤其是滤波器安装在PCB板上的情况下,这种辐射可以耦合到电源线,使传导发射增强。当磁性材料被带到场内时(例如,环形磁芯放置在铁壳里),差模磁导率就可能会显著地增加,从而由于差模电流而导致磁芯的饱和。无辐射共模扼流圈结构
为了实现有效的滤波器设计,磁通离开磁芯引起的辐射问题必须予以解决。其办法有是将差模磁通限制在磁性结构物体中(壶形铁芯),或者是为差模磁通(E形铁芯)提供一条高磁导率的路径。壶形铁芯结构
如果共模扼流圈采用壶形铁芯结构,那么就需两个绕轴。图4示意出了壶形铁芯窗格里的两组线圈及其产生的磁通路径。同时也表明了同一结构条件下的差模磁通路径。图4 共模壶形铁芯电感中的磁路
E形铁芯结构
另外还有一种共模扼流圈,它比环形磁芯线圈更易绕制,但比壶形铁芯线圈的辐射更厉害,E形铁芯线圈如图6所示。图中表明,共模磁通将外部引线上的两组线圈都联系在一起了。为了获得较高的磁导率,在外部引线上应没有空气隙。另一方面,差模磁通将外部引线和中心引线联系起来。差模路径中的磁导率可以通过使中心引线彼此隔开来取得,中心引线是产生辐射的主要区域。编辑本段共膜滤波器JEPSUN-CM系列
常用于: EMI辐射图5 壶形铁芯计算差模电感时的具体尺寸
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