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来源：互联网发布：网络版收银软件编辑：程序博客网时间：2024/06/11 03:34
1.产生10khz的脉冲模块
`timescale 1ns / 1ps///////////////////////////////////////////////////////////////////// Create Date: 2016/11/05 10:10:30// Design Name:// Module Name: phaze_10khz// Description: 10khz的脉冲//////////////////////////////////////////////////////////////////////////////////module phaze_10khz(clk_20m,r`timescale 1ns / 1ps///////////////////////////////////////////////////////////////////// Create Date: 2016/11/05 10:10:30// Design Name:// Module Name: phaze_10khz// Description: 10khz的脉冲//////////////////////////////////////////////////////////////////////////////////module phaze_10khz(clk_20m,rst,pluse_10khz);           input rst;           input clk_20m;           output reg pluse_10khz;           reg [31:0]cnt;              always@(posedge clk_20m or negedge rst )       if(!rst)         cnt<=32'd0;       else if(cnt==32'd2000)           cnt<=32'd0;       else         cnt<=cnt+1'b1;    always@(posedge clk_20m or negedge rst )          if(!rst)             pluse_10khz<=1'b0;           else if(cnt==32'd2000)               pluse_10khz<=1'b1;           else             pluse_10khz<=1'b0;endmodule

st,pluse_10khz); input rst; input clk_20m; output reg pluse_10khz; reg [31:0]cnt; always@(posedge clk_20m or negedge rst ) if(!rst) cnt<=32'd0; else if(cnt==32'd2000) cnt<=32'd0; else cnt<=cnt+1'b1; always@(posedge clk_20m or negedge rst ) if(!rst) pluse_10khz<=1'b0; else if(cnt==32'd2000) pluse_10khz<=1'b1; else pluse_10khz<=1'b0;endmodule


                                                     0        0           	
					
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