fpga检测上升沿
来源:互联网 发布:小米网络音箱拆解 编辑:程序博客网 时间:2024/05/16 19:23
检测上升沿的原理:使用高频的时钟对信号进行采样,因此要实现上升沿检测,时钟频率至少要在信号最高频率的2倍以上,否则就可能出现漏检测。具体请参见下面代码。
使用Quartus II综合布线之后的RTL视图如下:
从RTL视图中可以看出,电路是通过一个异步复位的D触发器实现的。
ModelSim的仿真视图如下,从中可看出已检测出上升和下降沿,但存在一个延时,这是因为使用了时钟同步的检测。
或者上面的Verilog代码还可以换一种写法,效率上差不了太多;
生成的RTL视图为
0 0
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