FPGA使用有符号数signed
来源:互联网 发布:美工注意事项 编辑:程序博客网 时间:2024/05/17 07:58
在FPGA中使用有符号数,进行有符号数的相关运算。
Verilog代码:
reg signed[3:0] sign_x;initial begin sign_x = 4'b1111;endalways @(posedge clk) sign_x <= sign_x + 1'b1;
使用有符号数,显示的是直接二进制补码:
后面继续写,深夜了
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